最后本文依照ASIC芯片设计方法对视频解码芯片预测模块进行硬件设计和仿真。
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A digital video decoder with high precision without using a phase locked loop
一种无锁相环的高精度数字视频彩色解码方案的研究
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本文着重从并行处理技术为切入点对高速视频解码器并行结构的设计方法进行了深入的研究。
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本文的主要贡献有:1.设计并实现了一种基于ARM的嵌入式AVS视频播放器,为软硬件协同完成AVS视频解码的设计思路提供了一个可行的解决方案。
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针对国内外厂商推出的各类通用原型验证平台价格昂贵,结构冗余的问题,本文提出了一种适用于AVS视频解码芯片设计的原型验证平台。
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在嵌入式操作系统平台下,摄像头模拟信号通过视频解码器进行数字化,经处理器转换为适合观看的格式,之后图像经压缩成MPEG-4格式,数据流通过CDMA无线模块发送。
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提出了一种适用于AVS的游程解码、反扫描、反量化和反变换硬件结构优化设计方案。
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在接收端,视频解码器仅需要Sub-GOP中的某一帧的分组就可以解码并显示该帧。
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A novel decentralized control scheme of dedicated MPEG 2 video decoder is presented.
本文提出了一种新的适用于MPEG2专用视频解码芯片的控制策略:分散控制.
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China's independent development of the audio-video standard of AVS Video decoder reference program.
中国自主开发的音视频标准AVS中的视频编解码参考程序.
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在AVS标准中的插值算法采用分像素提高视频解码的清晰度,也是解码端主要的访存和计算瓶颈。
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压缩的注被通过网络或是电信联接传输走,并在视频解码端进行解码。解码过的帧就可以被显示了,H。
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Research of the Methods for Decoding Bit Stream in Video Decoder System
视频解码系统中对输入码流进行译码的方法的研究
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The hardware of image processing system is composed by video decoder, DSP, CPLD, etc.
硬件上构建了以视频解码芯片、DSP芯片和CPLD器件为核心的实时图像处理硬件平台;
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